AVS解码器在DSP平台上的优化
AVS(Audio Video Coding STandard)是由我国数字音视频标准工作组制定的具有自主知识产权的第二代音视频压缩准。AVS实行1 元专利费用的原则，相比其它音视频编解码标准具有编码效率高、专利费用低、授权模式简单等优势。AVS解码器的结构复杂、运算量较大，要在嵌入式平台上实现实时解码具有较大难度。在对解码器性能优化的过程中可以依据使用平台对其进行汇编指令集的优化或者针对解码器的关键算法模块进行改良，以上方法对解码器性能的提高均有一定作用，本文提出一种利用嵌入式平台的L1P Cache高速缓冲功能实现处理器对程序代码的高效率访问的方法，从而达到提高AVS解码器性能的目的。
1 高速缓存Cache的应用
目前越来越多的编解码算法采用DSP的方式实现，随着DSP芯片主频的不断攀升，存储器的访问速度日益成为系统性能提升的瓶颈。在现有的制造工艺下，片上存储单元的增加将导致数据线负载电容的增加，影响到数据线上信号的开关时间，这意味着片上高速存储单元的增加将是十分有限的。为了解决存储器速度与CPU内核速度不匹配的问题，高性能的CPU普遍采用高速缓存(Cache)机制。
以TI的C64x DSP为例，存储器系统由片内存储器和片外存储器两部分组成。其中，片内存储器采用两级缓存结构，第1级L1距离DSP核最近，数据访问速度最快，可以达到每秒600Mbyte，只能作为不能寻址的Cache使用，由相互独立的L1P和L1D组成。
L1P Cache是处理器访问程序代码的高速缓冲存储器，大小为16kbyte，采用直接映射方式，每行大小32byte;L1D Cache是处理器访问数据的高速缓冲存储器，大小为16 kbyte，采用2路映射，每行大小为64byte。第2级L2是一个统一的程序/数据空间，可以整体作为SRAM映射到存储空间，也可以作为Cache和SRAM按比例的一种组合。L2与L1之间的数据交互速率为每秒300Mbyte，L2与SDRAM之间的数据交换速率为每秒100Mbyte。片外存储器是第3级，一般由SDRAM构成。L1、L2和片外SDRAM构成了整个存储器系统的层次结构。C64X的两级缓存结构若能运用恰当，将能极大地提高程序性能。
